• 大小: 67KB
    文件类型: .doc
    金币: 1
    下载: 0 次
    发布日期: 2021-05-23
  • 语言: 其他
  • 标签: Verilog  

资源简介

4位并行乘法器的电路设计与仿真 1. 实现4位并行乘法器的电路设计; 2. 带异步清零端; 3. 输出为8位; 4. 单个门延迟设为5 ns。

资源截图

代码片段和文件信息

评论

共有 条评论