资源简介
完整的AES加密的verilog代码,经过验证在FPGA内可以实现,而且还附带相应的仿真环境和可以执行的脚本文件,极具参考价值,一种典型的AES加密的verilog实现方式
代码片段和文件信息
属性 大小 日期 时间 名称
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目录 0 2017-07-17 10:05 aes_core\
目录 0 2017-07-17 10:05 aes_core\CVS\
文件 56 2006-04-06 22:35 aes_core\CVS\Entries
文件 22 2006-04-06 22:35 aes_core\CVS\Entries.Extra
文件 0 2006-04-06 22:35 aes_core\CVS\Entries.Extra.Old
文件 67 2006-04-06 22:36 aes_core\CVS\Entries.Log
文件 0 2006-04-06 22:35 aes_core\CVS\Entries.Old
文件 10 2006-04-06 22:35 aes_core\CVS\Repository
文件 57 2006-04-06 22:35 aes_core\CVS\Root
文件 0 2006-04-06 22:35 aes_core\CVS\Template
目录 0 2005-07-23 14:00 aes_core\bench\
目录 0 2005-07-23 14:00 aes_core\bench\CVS\
文件 3 2006-04-06 22:35 aes_core\bench\CVS\Entries
文件 0 2006-04-06 22:35 aes_core\bench\CVS\Entries.Extra
文件 0 2006-04-06 22:35 aes_core\bench\CVS\Entries.Extra.Old
文件 17 2006-04-06 22:35 aes_core\bench\CVS\Entries.Log
文件 0 2006-04-06 22:35 aes_core\bench\CVS\Entries.Old
文件 16 2006-04-06 22:35 aes_core\bench\CVS\Repository
文件 57 2006-04-06 22:35 aes_core\bench\CVS\Root
文件 0 2006-04-06 22:35 aes_core\bench\CVS\Template
目录 0 2017-07-17 10:05 aes_core\bench\verilog\
目录 0 2005-07-23 14:00 aes_core\bench\verilog\CVS\
文件 53 2006-04-06 22:35 aes_core\bench\verilog\CVS\Entries
文件 23 2006-04-06 22:35 aes_core\bench\verilog\CVS\Entries.Extra
文件 0 2006-04-06 22:35 aes_core\bench\verilog\CVS\Entries.Extra.Old
文件 0 2006-04-06 22:35 aes_core\bench\verilog\CVS\Entries.Old
文件 24 2006-04-06 22:35 aes_core\bench\verilog\CVS\Repository
文件 57 2006-04-06 22:35 aes_core\bench\verilog\CVS\Root
文件 0 2006-04-06 22:35 aes_core\bench\verilog\CVS\Template
文件 37504 2002-11-13 00:10 aes_core\bench\verilog\test_bench_top.v
目录 0 2017-07-17 10:05 aes_core\doc\
............此处省略110个文件信息
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目录 0 2017-07-17 10:05 aes_core\
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文件 56 2006-04-06 22:35 aes_core\CVS\Entries
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文件 67 2006-04-06 22:36 aes_core\CVS\Entries.Log
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文件 10 2006-04-06 22:35 aes_core\CVS\Repository
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文件 37504 2002-11-13 00:10 aes_core\bench\verilog\test_bench_top.v
目录 0 2017-07-17 10:05 aes_core\doc\
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