基于FPGA的数字示波器代码verilog

基于FPGA的数字示波器代码（verilog），采用等效采样，并作VGA显示，可以上下左右移动波形，分为多频段显示。

 属性            大小     日期    时间   名称
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     文件       1951  2013-05-07 14:55  fpga数字滤波器\HZMV.mif

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     文件       6290  2013-05-06 18:17  fpga数字滤波器\pinfu.mif

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     文件       1984  2013-07-03 09:46  fpga数字滤波器\pinlv.v.bak

     文件       3459  2013-07-03 11:20  fpga数字滤波器\pll.bsf

     文件        928  2013-07-03 11:20  fpga数字滤波器\pll.cmp

     文件        855  2013-07-03 11:20  fpga数字滤波器\pll.inc

     文件        422  2013-07-03 11:20  fpga数字滤波器\pll.ppf

     文件        681  2013-07-03 11:20  fpga数字滤波器\pll.qip

     文件      15896  2013-07-03 11:20  fpga数字滤波器\pll.v

............此处省略549个文件信息