资源简介
这个基于FPGA的16阶FIR低通滤波器工程,Verilog HDL,有仿真代码,很实用哦!
代码片段和文件信息
clear all;
close all;
load matlab.mat;
A=Num1;
A=2^9*A;
B=round(A);
fi=fopen(‘conf.dat‘‘wb‘);
% B=dec2bin(B);
A=fprintf(fi‘%\n‘B);
fclose(fi);
属性 大小 日期 时间 名称
----------- --------- ---------- ----- ----
文件 4314 2013-12-21 17:22 FIR\Block1.bdf
文件 1782 2014-03-28 11:16 FIR\cont_addr.bsf
文件 182 2014-03-28 11:16 FIR\cont_addr.v
文件 177 2014-03-28 11:15 FIR\cont_addr.v.bak
文件 1430 2013-12-16 16:29 FIR\db\add_sub_1ch.tdf
文件 1430 2014-03-27 17:31 FIR\db\add_sub_2ch.tdf
文件 1433 2013-12-16 16:29 FIR\db\add_sub_3ch.tdf
文件 1430 2014-01-05 20:38 FIR\db\add_sub_4ch.tdf
文件 1430 2014-03-27 17:31 FIR\db\add_sub_5ch.tdf
文件 1430 2014-03-27 17:31 FIR\db\add_sub_6ch.tdf
文件 1430 2014-03-27 17:31 FIR\db\add_sub_7ch.tdf
文件 1425 2014-03-28 11:25 FIR\db\add_sub_88h.tdf
文件 1430 2014-01-05 20:38 FIR\db\add_sub_8ch.tdf
文件 1430 2014-03-27 17:31 FIR\db\add_sub_9ch.tdf
文件 1430 2014-01-05 20:38 FIR\db\add_sub_ach.tdf
文件 1430 2014-03-27 17:31 FIR\db\add_sub_bch.tdf
文件 1427 2014-06-03 10:25 FIR\db\add_sub_bfh.tdf
文件 1537 2014-03-28 11:25 FIR\db\add_sub_dkh.tdf
文件 1537 2014-04-10 11:33 FIR\db\add_sub_ekh.tdf
文件 1537 2014-04-10 11:33 FIR\db\add_sub_fkh.tdf
文件 1427 2014-04-10 11:33 FIR\db\add_sub_g9h.tdf
文件 1537 2014-03-28 11:25 FIR\db\add_sub_gkh.tdf
文件 1845 2013-12-16 16:29 FIR\db\add_sub_gvd.tdf
文件 1430 2014-04-10 11:33 FIR\db\add_sub_h9h.tdf
文件 1537 2014-04-10 10:11 FIR\db\add_sub_hkh.tdf
文件 1430 2014-03-28 11:25 FIR\db\add_sub_i9h.tdf
文件 1537 2014-04-10 10:11 FIR\db\add_sub_ikh.tdf
文件 1430 2014-04-10 10:11 FIR\db\add_sub_j9h.tdf
文件 1429 2014-06-03 10:21 FIR\db\add_sub_jgh.tdf
文件 1537 2014-03-28 11:25 FIR\db\add_sub_jkh.tdf
............此处省略616个文件信息
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