基于FPGA的数据采集系统资料齐全，代码备注

基于FPGA的数据采集系统。 主要实现功能流程为：首先通过串口向FPGA发送控制信号，控制DAC芯片tlv5618进行DA装换，转换的数据存在ROM中，转换开始时读取ROM中数据进行读取转换。其次用按键控制adc128s052进行模数转换100次，模数转换数据存储到FIFO中，再从FIFO中读取数据通过串口输出显示在pc上。 该系统主要包括9个模块：串口接收模块、按键消抖模块、按键控制模块、ROM模块、DAC驱动模块、ADC驱动模块、同步FIFO模块、FIFO控制模块、串口发送模块。各个模块的作用如下： （1）串口接收模块（UART_Byte_Rx.v）：完成串口数据接收，将串行数据转换成并行数据输出。 （2）按键消抖模块（key_filter.v）：进行按键消抖，可输出一个脉冲按键按下标志和按键按下时间标志。 （3）按键控制模块（key_ctrl.v）：当在DA一直输出模拟信号时，按下按键控制ADC转换100次。 （4）ROM模块（single_port_rom.v）：存储DA转换的数据，可存放正弦波形数据。 （5）DAC驱动模块（dac_driver.v）：数模转换驱动模块，与外部DAC芯片相连，提供DAC芯片时钟和数据信号等。 （6）ADC驱动模块（adc_driver.v）：模数转换驱动模块，与外部ADC芯片相连，提供ADC芯片时钟和控制信号等。 （7）同步FIFO模块（sync_fifo.v）：存放ADC转换后的数据。 （8）FIFO控制模块（fifo_ctrl.v）：当FIFO中有数据时，将FIFO中的数据转换成可以UART串口发送的数据。 （9）串口发送模块（Uart_Byte_Tx.v）：经过FIFO控制模块转换的数据通过串口发送模块发送到串口，显示在pc端。 （10）DAC控制模块（dac_ctrl.v）：当接收串口指定的指令时，开始将ROM的正弦数据进行DAC转换。

i=0:2*pi/4095:2*pi;
y=（sin（i）+1）*4095/2;
k=dec2bin（round（y））;
fid=fopen（‘F:\FPGA\fpga program\xiaomeige_Verilog\data_collection\par\simulation\modelsim\sin_12bit.txt‘‘wt‘）;

for i=1:4096%1024行
    for j=1:12%11列
        fprintf（fid‘%s‘k（ij））;%输出
            if mod（j12）==0%判断是否输出了11个字符
                fprintf（fid‘\n‘）;%每输出11个字符也就是输出了一行，输出一个回车
            end;
	 end;
end;
fclose（fid）;

 属性            大小     日期    时间   名称
----------- ---------  ---------- -----  ----
     目录           0  2020-05-10 22:18  data_collection\
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     文件      168964  2020-05-18 13:21  data_collection\doc\fifo读.png
     文件      177412  2020-05-18 13:22  data_collection\doc\fifo边读边写.png
     文件       32667  2020-05-21 10:23  data_collection\doc\rtl视图.pdf
     文件         241  2020-05-17 13:14  data_collection\doc\sin_12bit.asv
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     文件      126699  2020-05-21 11:24  data_collection\doc\串口收到ADC采样数据.png
     文件       31790  2020-05-22 15:37  data_collection\doc\系统框图.png
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............此处省略387个文件信息