RS编解码VERILOG实现

RS 编码器，译码器，主要采用FPGA来实现软件使用verilog语言，从原理到硬件的实现，进行了功能仿真 以及板上调试，验证正确

 属性            大小     日期    时间   名称
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     文件      65937  2010-01-25 13:21  RS_main\device_usage_statistics.html

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     文件        142  2010-01-25 11:52  RS_main\ila_flist.txt

     文件       1822  2010-01-25 11:52  RS_main\ila_readme.txt

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     文件       5756  2010-01-25 13:20  RS_main\main.bgn

     文件     283864  2010-01-25 13:20  RS_main\main.bit

     文件       1641  2010-01-25 12:51  RS_main\main.bld

     文件       1508  2010-01-25 13:14  RS_main\main.cmd_log

     文件       1309  2010-01-25 13:19  RS_main\main.drc

     文件        159  2010-01-25 11:31  RS_main\main.lfp

............此处省略263个文件信息