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文档版本：v0.0.00Beta 更新日期：2006-05-21
本译文仅为学习及提供更多信息之目的，任何人不得将其用作商业用途。除非特别声明，原文版权归作者所有，如有转摘请注明原作者以及译者（FPGA技术网）信息。本译文会不断更新，要获得本译文的最新版本请查看本文的在线版本SystemVerilog 3.1a 语言参考手册。
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