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RISC V官方手册中英文各个版本 0

编程语言：其他大小：金币：上传人：fuaoxing55 发布日期：2023-10-07

RISC-V（发音为“risk-five”）是一个基于精简指令集（RISC）原则的开源指令集架构（ISA）。本资源包含RISC V官方文档，中英文各个版本。
自己动手写CPU（光盘+PDF+整体图） 1

编程语言：其他大小：金币：上传人：pppxxx 发布日期：2023-01-02

《自己动手写CPU》/使用Verilog语言设计CPU/pdf+光盘语言的介绍环境的搭建设计步骤与过程
使用Verilog 写 RISC CPU 资料和代码 0

编程语言：其他大小：金币：上传人：wjd2002xx 发布日期：2021-06-08

使用Verilog 写 RISC CPU 资料和代码，内容广，是CPU设计的备之作
RISC-CPU全部模块Verilog代码 0

编程语言：其他大小：金币：上传人：haoyisheng 发布日期：2021-05-29

Verilog数字系统设计教程，夏宇闻版，RISC-CPU代码
基于Vivado的精简指令CPU设计 0

编程语言：其他大小：金币：上传人：rtesd 发布日期：2021-05-20

利用Xilinx的Vivado套件（包括VivadoHLS）设计的精简指令集CPU架构，里面包含了各个模块所需的仿真文件。下载资源的人需要先了解一下ARM指令集与ARM架构。
大型RISC处理器设计-用描述语言Veril 0

编程语言：其他大小：金币：上传人：wjd2002xx 发布日期：2021-05-16

《大型RISC处理器设计-用描述语言Verilog设计VLSI芯片》，可以通过该书熟悉RISC处理机，还有VLSI设计的流程与理念，不过这里只是提供该书的CD，这本书其实也不贵，个人感觉很值
精简指令集的8位CPU的verilog源代码 0

编程语言：其他大小：金币：上传人：fuaoxing55 发布日期：2021-01-03

verilog设计的精简指令集8位CPU源代码，里面有验证平台，以及后端DC的综合报告，门级网表，以及覆盖率报告。

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