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Verilog 实现的UART通讯 0

编程语言：其他大小：金币：上传人：rtesd 发布日期：2023-09-23

Verilog 编写的UART核，可以实现可定义形式数据的收到，测试工作正常
扫码模块配合STM32 0

编程语言：其他大小：金币：上传人：huaihuan 发布日期：2023-09-09

利用扫码模块与STM32进行配合，看相应二维码或条形码是否正确
基于verilog的多周期CPU设计 0

编程语言：其他大小：金币：上传人：haoyisheng 发布日期：2023-07-30

本项目主要利用Verilog语言设计一一个基于MIPS架构的CPU。分别设计指令存储器、寄存器堆、ALU、取指令部件、数据存储器、立即数处理单元、主单元控制器、ALU控制单元。将这些单元连城
数据结构-串的模式匹配算法Java实现 1

编程语言：Java 大小：金币：上传人：chaoshanxx 发布日期：2021-06-18

编程实现如下功能：1、在实验六的基础上，实现串的Brute-Force模式匹配算法。2、尝试实现串的KMP模式匹配算法。
串的基本操作演示 0

编程语言：其他大小：金币：上传人：32332 发布日期：2021-01-01

串的基本演示包括：求子串、串长、串的比较、串连接等

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