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宽频带数字锁相环的设计及基于FPGA的 0

编程语言：其他大小：金币：上传人：97804a 发布日期：2024-03-01

本文简要介绍了在FPGA中实现全数字锁相环(DPLL)的原理与方法，以解决在同步串行数据通信时的同步时钟不稳定时的快速恢复问题；并重点介绍了采用可控模数分频器实现的数字锁相环中

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