资源简介
全部用Verilog表述,在QuartusII上完成简易正弦信号发生器设计,包括建立工程,生成正弦信号波形数据,ModelSim仿真。下载至FPGA中,通过SignalTapLogicAnalyzer观察波形。
代码片段和文件信息
属性 大小 日期 时间 名称
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文件 1158144 2019-04-08 19:44 lab2shiyanbaogao_zyf\lab2.doc
目录 0 2018-11-04 19:00 lab2shiyanbaogao_zyf\
文件 433 2018-11-04 16:51 lab2shiyanbaogao_zyf\CNT7B.v
文件 2416 2018-11-04 17:25 lab2shiyanbaogao_zyf\alt_sld_fab.v
文件 21216 2018-11-04 17:25 lab2shiyanbaogao_zyf\alt_sld_fab_alt_sld_fab.v
文件 1933 2018-11-04 16:53 lab2shiyanbaogao_zyf\boxing128.hex
文件 1884 2018-11-04 15:26 lab2shiyanbaogao_zyf\boxing128.mif
文件 1321 2018-11-04 16:50 lab2shiyanbaogao_zyf\lab2.qpf
文件 16311 2018-11-04 17:50 lab2shiyanbaogao_zyf\lab2.qsf
文件 497 2018-11-04 17:56 lab2shiyanbaogao_zyf\lab2_run_msim_rtl_verilog.do
文件 6601 2018-11-04 16:55 lab2shiyanbaogao_zyf\rom78.v
文件 5107 2018-11-04 16:55 lab2shiyanbaogao_zyf\rom78_bb.v
文件 92 2018-11-04 16:55 lab2shiyanbaogao_zyf\rom78_inst.v
文件 1933 2018-11-04 16:53 lab2shiyanbaogao_zyf\sin.hex
文件 1884 2018-11-04 13:52 lab2shiyanbaogao_zyf\sin.mif
文件 427 2018-11-04 16:52 lab2shiyanbaogao_zyf\sin_gen.v
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文件 1158144 2019-04-08 19:44 lab2shiyanbaogao_zyf\lab2.doc
目录 0 2018-11-04 19:00 lab2shiyanbaogao_zyf\
文件 433 2018-11-04 16:51 lab2shiyanbaogao_zyf\CNT7B.v
文件 2416 2018-11-04 17:25 lab2shiyanbaogao_zyf\alt_sld_fab.v
文件 21216 2018-11-04 17:25 lab2shiyanbaogao_zyf\alt_sld_fab_alt_sld_fab.v
文件 1933 2018-11-04 16:53 lab2shiyanbaogao_zyf\boxing128.hex
文件 1884 2018-11-04 15:26 lab2shiyanbaogao_zyf\boxing128.mif
文件 1321 2018-11-04 16:50 lab2shiyanbaogao_zyf\lab2.qpf
文件 16311 2018-11-04 17:50 lab2shiyanbaogao_zyf\lab2.qsf
文件 497 2018-11-04 17:56 lab2shiyanbaogao_zyf\lab2_run_msim_rtl_verilog.do
文件 6601 2018-11-04 16:55 lab2shiyanbaogao_zyf\rom78.v
文件 5107 2018-11-04 16:55 lab2shiyanbaogao_zyf\rom78_bb.v
文件 92 2018-11-04 16:55 lab2shiyanbaogao_zyf\rom78_inst.v
文件 1933 2018-11-04 16:53 lab2shiyanbaogao_zyf\sin.hex
文件 1884 2018-11-04 13:52 lab2shiyanbaogao_zyf\sin.mif
文件 427 2018-11-04 16:52 lab2shiyanbaogao_zyf\sin_gen.v
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