SHA-256的一种verilogHDL实现

SHA-256的一种verilogHDL实现，包括testbench，quartusII可综合。SHA是一种数据加密算法，该算法经过加密专家多年来的发展和改进已日益完善，现在已成为公认的最安全的散列算法之一，并被广泛使用。该算法的思想是接收一段明文，然后以一种不可逆的方式将它转换成一段（通常更小）密文，也可以简单的理解为取一串输入码（称为预映射或信息），并把它们转化为长度较短、位数固定的输出序列即散列值（也称为信息摘要或信息认证代码）的过程。

 属性            大小     日期    时间   名称
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     文件       5212  2012-12-12 09:24  testsha256.v

     文件      32705  2012-12-12 09:16  sha256.v

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