FPGA数字跑表设计

FPGA数字跑表设计，内附项目设计分析报告+Verilog HDL代码+仿真结果，可直接烧写于FPGA中，适用于FPGA的初学者使用！

 属性            大小     日期    时间   名称
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     文件        680  2018-07-09 11:58  数字跑表FPGA\vivado.jou

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     文件     102912  2020-06-29 16:22  数字跑表FPGA\分析报告.doc

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     文件        943  2018-07-09 09:06  数字跑表FPGA\数电大作业.sim\sim_1\behav\webtalk_6368.backup.log

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............此处省略60个文件信息